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칩 스태킹 공정에서 TSV(관통 실리콘 비아) 내 구리의 열팽창으로 인한 돌출(구리 펌핑) 현상은 반도체 칩의 신뢰성을 저하시키는 주요 원인입니다. 특히 고온 공정에서 발생하는 이러한 문제는 BEOL 층 손상으로 이어질 수 있습니다. 본 기술은 이러한 구리 돌출 현상을 사전에 예측하여 칩 스태킹 공정의 신뢰성을 확보하고 불량률을 감소시키는 혁신적인 시스템 및 예측 방법을 제공합니다. TSV의 초기 형상, 구리 결정립 정보, 열처리 조건 등 다양한 데이터를 입력받아, 구리 결정립 성장률 및 열변형을 정밀하게 시뮬레이션하여 구리 돌출량을 예측합니다. 이 시스템은 시뮬레이션 결과를 시각화하여 제공함으로써, 반도체 제조 공정 최적화에 기여하고 잠재적인 불량을 미연에 방지할 수 있습니다. 본 기술을 통해 고품질 반도체 생산에 기여하고 불량률을 획기적으로 낮출 수 있습니다.
| 기술명 | |
| 칩 스태킹 공정의 관통 실리콘 비아 구리돌출량 예측시스템 및 예측방법 | |
| 기관명 | |
| 서강대학교산학협력단 | |
| 대표 연구자 | 공동연구자 |
| 김동철 | - |
| 출원번호 | 등록번호 |
| 1020180134689 | 1022514690000 |
| 권리구분 | 출원일 |
| 특허 | 2018.11.05 |
| 중요 키워드 | |
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